news 2026/7/26 4:32:05

TI 18xx TPTC MPU配置实战：从原理到调试，构建可靠嵌入式内存保护

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张小明

前端开发工程师

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TI 18xx TPTC MPU配置实战：从原理到调试，构建可靠嵌入式内存保护

1. 项目概述与MPU核心价值解析

在嵌入式系统开发，尤其是汽车电子、工业控制这类对可靠性要求极高的领域，一个野指针或者越界的DMA传输就可能导致整个系统宕机，甚至引发安全事故。我处理过不少因为内存访问越界导致的“灵异”故障，排查起来往往耗时耗力。后来我发现，很多现代微控制器（MCU）都内置了一个硬件“保镖”——内存保护单元（MPU），但很多开发者要么不知道它的存在，要么觉得配置起来太麻烦而弃之不用，这其实是在浪费芯片提供的宝贵安全特性。

TI的18xx系列MPU，作为其高性能微控制器家族的一员，就集成了非常完善的MPU机制。它不仅仅是保护CPU访问的内存，更关键的是能保护像TPTC（Third-Party Transfer Controller）这类复杂外设的DMA通道对内存的读写。TPTC你可以理解为TI自家高性能的DMA控制器，负责在芯片内部各个总线主设备（如CPU、其他加速器）和存储器之间搬运数据。如果TPTC的读写行为不受控，其破坏力比CPU的野指针更大，因为它可能在后台持续地覆盖错误的内存区域。本文将以TPTC模块的MPU配置为例，手把手带你吃透TI 18xx的MPU寄存器配置逻辑。这不是简单的寄存器列表翻译，而是结合我实际调试的经验，告诉你每个配置项背后的设计意图、常见的配置陷阱以及如何构建一个健壮的内存保护方案。无论你是正在评估18xx系列芯片，还是正在为现有项目增加可靠性加固，理解这套机制都至关重要。

2. MPU基础与TI 18xx TPTC MPU架构深度剖析

2.1 MPU工作原理：从概念到硬件实现

内存保护单元（MPU）本质上是一个硬件实现的“守门人”。它位于总线主设备（如CPU核心、DMA控制器）和内存（或外设）之间，监控每一次访问请求。你可以把它想象成大楼的安保系统：每个房间（内存区域）都有门禁规则，只有持有正确权限卡（正确的访问属性）的人（总线主设备）才能进入。

MPU的核心工作是地址匹配和权限检查。它内部维护着一张“区域配置表”，这张表的每一项定义了一个连续的内存地址范围（起始地址和结束地址），以及对这个区域的访问规则（如：是否允许读、写、执行）。当一个总线主设备发起一次访问（比如TPTC要往某个地址写数据），MPU会拿这个目标地址去和配置表中的每一个区域进行比对。如果地址落在某个已启用（Valid）的区域范围内，则根据该区域的权限规则决定是放行还是触发一个错误异常；如果地址没有落在任何已启用的区域，根据MPU的全局策略（通常也是触发错误），这次访问也会被阻止。

TI 18xx的TPTC MPU将这一概念做了更精细的划分。首先，它为TPTC的读端口和写端口分别配备了独立的MPU。这一点非常关键，因为读和写操作的安全敏感性不同。错误的写操作会破坏数据，危害性更大；而错误的读操作可能导致信息泄露或逻辑错误。分开控制允许我们为同一块内存区域设置不同的读写权限。其次，每个端口的MPU支持多个独立的保护区域（从输入资料看，至少支持Region 0到Region 5，共6个）。这让我们能够对系统的内存空间进行灵活、精细的划分，例如将代码区、数据区、外设寄存器区、共享缓冲区等分别用不同的区域规则保护起来。

2.2 TPTC MPU寄存器组全景解读

输入资料中给出了大量寄存器，初看令人眼花缭乱，但如果我们按功能归类，其结构非常清晰。整个TPTC MPU的配置寄存器可以分为以下几大类：

  1. 地址范围寄存器：这是MPU的“地图绘制”工具。每个区域需要一对寄存器来定义其边界：

    • TPTCxWRMPUSTADDy：定义TPTCx写端口，第y个区域的起始地址。
    • TPTCxWRMPUENDADDy：定义TPTCx写端口，第y个区域的结束地址。
    • TPTCxRDMPUSTADDy/TPTCxRDMPUENDADDy：同理，用于TPTCx读端口。
    • 关键细节：这里的x代表TPTC实例（如TPTC0, TPTC1），y代表区域编号（0-5）。起始和结束地址共同确定了一个连续的地址区间。

  2. 区域使能寄存器：这是每个区域的“电源开关”。光有地图范围还不够，必须显式打开区域的保护功能。

    • TPTCMPUVALIDCFG：这是一个非常重要的复合功能寄存器。它用位域（bit field）的方式，集中控制了所有端口所有区域的使能状态。
      • TPTC0WRMPURNGVLD(bits 7-0): 控制TPTC0写端口的Region 0-7（注意，资料显示Region 0-5，但寄存器预留了8位，具体以芯片手册为准，通常位0对应Region 0）。写1使能对应区域。
      • TPTC0RDMPURNGVLD(bits 15-8): 控制TPTC0读端口的Region 0-7。
      • TPTC1WRMPURNGVLD(bits 23-16): 控制TPTC1写端口。
      • TPTC1RDMPURNGVLD(bits 31-24): 控制TPTC1读端口。
    • 设计意图：这种集中式的使能控制，便于软件进行原子性的配置更新。你可以在计算好所有地址范围后，一次性写入这个寄存器来激活所有区域，避免在配置过程中出现保护空窗期。

  3. MPU全局控制与状态寄存器：这是MPU的“总闸”和“故障记录仪”。

    • TPTCMPUENCFG：这是MPU模块的总开关和错误清除寄存器。
      • TPTCxWRMPUEN/TPTCxRDMPUEN(bits 0-3): 这些是全局使能位。只有当对应端口的这个位为1时，该端口的MPU保护才生效。即使TPTCMPUVALIDCFG中某个区域位被置1，如果全局使能位为0，MPU也不会进行任何检查。这是一个常见的配置陷阱：只开了区域使能，忘了开全局使能，导致MPU形同虚设。
      • TPTCxWRMPUERRCLR/TPTCxRDMPUERRCLR(bits 4-7):错误清除位。当MPU检测到违规访问并触发错误后，硬件会置位一个内部错误标志（通常在一个状态寄存器中，资料未明确给出，可能需要查询其他系统状态寄存器），并可能产生中断或触发安全错误响应。向这些位写1，可以清除对应的错误标志。注意描述中的“wspecial access type - a write to this field generate a pulse”，这意味着这是一个“写1清零”的脉冲型操作，通常你只需要写1，硬件会自动将其清零。

  4. 错误地址捕获寄存器：这是“事故现场记录器”。当MPU拦截到一次非法访问时，光知道出错还不够，必须知道是访问哪个地址出的错，才能定位问题代码。

    • TPTCxWRMPUERRADD/TPTCxRDMPUERRADD：这两个是只读寄存器。一旦某端口的MPU触发错误，触发该错误的访问地址就会被锁存到对应的这个寄存器中。这对于调试至关重要。你可以在这个寄存器中读到导致错误的准确地址，结合你的内存布局图，就能快速定位是哪个缓冲区越界了。

实操心得一：理解“区域”与“全局”的两级使能很多新手配置MPU失败，就是因为混淆了TPTCMPUVALIDCFG（区域使能）和TPTCMPUENCFG中的TPTCxMPUEN（全局使能）。你必须两者都正确配置，MPU才会工作。我的习惯是：先配置好所有地址范围寄存器，然后设置TPTCMPUVALIDCFG使能所需区域，最后再置位TPTCMPUENCFG中的全局使能位。关闭时顺序相反，先关全局使能，再修改区域配置。

3. 核心寄存器配置详解与实战编程指南

3.1 地址范围寄存器的计算与对齐要求

地址范围寄存器是32位全字宽寄存器，用于存储一个32位的内存地址。配置时，起始地址和结束地址都必须满足MPU要求的内存对齐。虽然资料没有明确说明，但根据常见的ARM Cortex-R/M系列MPU以及TI其他平台的经验，对齐粒度通常是32字节、1KB或更大。不满足对齐的配置可能被硬件忽略或导致不可预知的行为。

如何计算和设置地址范围？假设我们要保护一块位于0x8000_0000，大小为4KB（0x1000字节）的共享缓冲区，供TPTC0的写端口使用，将其配置为Region 1。

  1. 起始地址：TPTC0WRMPUSTADD1=0x80000000。
  2. 结束地址：这里有一个关键点需要理解。MPU的结束地址寄存器存放的是该区域最后一个字节的地址，而不是“起始地址+大小”。所以，对于从0x80000000开始，大小为0x1000的区域：
    • 最后一个字节的地址 = 起始地址 + 大小 - 1 =0x80000000 + 0x1000 - 1 = 0x80000FFF。
    • 因此，TPTC0WRMPUENDADD1=0x80000FFF。

配置示例代码（C语言风格）：

// 假设 REG_TPTC0_WR_MPU_STADD1 等是映射到寄存器地址的宏或指针 #define REG_TPTC0_WR_MPU_STADD1 (*(volatile uint32_t*)0xFFFFE14C) // 假设基址+偏移 #define REG_TPTC0_WR_MPU_ENDADD1 (*(volatile uint32_t*)0xFFFFE168) void configure_mpu_region_for_buffer(void) { uint32_t buffer_start = 0x80000000; uint32_t buffer_size = 0x1000; // 4KB uint32_t buffer_end = buffer_start + buffer_size - 1; // 步骤1：配置地址范围 REG_TPTC0_WR_MPU_STADD1 = buffer_start; REG_TPTC0_WR_MPU_ENDADD1 = buffer_end; // 注意：在实际操作中，可能需要内存屏障（如 DSB, ISB）来确保配置顺序 __asm volatile("dsb sy"); __asm volatile("isb sy"); }

3.2 TPTCMPUVALIDCFG：区域使能的位图艺术

TPTCMPUVALIDCFG寄存器是一个32位的位图控制器。每个端口的8位字段，从低位到高位，依次对应Region 0到Region 7（或Region 0-5，高位保留）。例如，要使能TPTC0写端口的Region 1和Region 3，同时使能TPTC0读端口的Region 0，你需要构造一个值：

  • TPTC0WRMPURNGVLD(bits 7-0): 需要设置 bit1 和 bit3 为1。即(1 << 1) | (1 << 3) = 0x0A。
  • TPTC0RDMPURNGVLD(bits 15-8): 需要设置 bit8 (对应Region 0) 为1。即(1 << 8) = 0x0100。
  • 假设TPTC1暂时不用，其对应字段保持为0。
  • 最终写入TPTCMPUVALIDCFG的值就是0x0000010A。

编程技巧：使用位操作宏提高可读性

#define MPU_VALID_CFG_TCPT0_WR_RGN0 (1u << 0) #define MPU_VALID_CFG_TCPT0_WR_RGN1 (1u << 1) #define MPU_VALID_CFG_TCPT0_RD_RGN0 (1u << 8) // ... 其他区域定义 void enable_mpu_regions(void) { uint32_t valid_cfg_value = 0; // 使能 TPTC0 WR Region 1 & 3 valid_cfg_value |= MPU_VALID_CFG_TCPT0_WR_RGN1; valid_cfg_value |= MPU_VALID_CFG_TCPT0_WR_RGN3; // 使能 TPTC0 RD Region 0 valid_cfg_value |= MPU_VALID_CFG_TCPT0_RD_RGN0; // 写入寄存器 REG_TPTCMPUVALIDCFG = valid_cfg_value; __asm volatile("dsb sy"); }

3.3 TPTCMPUENCFG：全局开关与错误处理

这是MPU的“总闸”和“复位按钮”。配置时需注意：

  1. 全局使能：在确认所有地址范围和区域使能都配置无误后，最后才打开全局使能。例如，要启用TPTC0的读写MPU：
    REG_TPTCMPUENCFG |= (1 << 0) | (1 << 1); // 置位 TPTC0WRMPUEN 和 TPTC0RDMPUEN
  2. 错误清除：当系统检测到MPU错误（可能通过中断或状态寄存器查询得知）后，在服务程序中，除了处理错误本身，必须清除错误标志，否则MPU可能持续处于错误状态，阻塞后续所有访问或重复触发错误。
    void mpu_error_handler(void) { // 1. 读取 TPTC0WRMPUERRADD 或 TPTC0RDMPUERRADD 定位错误地址 uint32_t fault_addr = REG_TPTC0WRMPUERRADD; // ... 记录或处理错误地址 ... // 2. 清除错误标志（写1清零） REG_TPTCMPUENCFG |= (1 << 4); // 写 TPTC0WRMPUERRCLR 位 // 如果读端口也出错，可能需要清除 (1 << 5) // 3. 执行内存屏障，确保操作完成 __asm volatile("dsb sy"); }

    注意：错误清除位是“写1清零”，且是脉冲型的。这意味着你只需要执行一次写1操作，硬件会自动将其复位为0。你不需要也不应该去写0。

4. 实战配置流程与系统集成策略

4.1 一个完整的TPTC MPU配置流程

假设一个典型场景：TPTC0用于从外部ADC读取数据到内部SRAM的一个缓冲区，同时从另一个SRAM区域读取数据通过某个端口发送出去。我们需要保护这两个缓冲区不被意外的写访问破坏。

  1. 步骤一：规划内存区域

    • Region 0 (写保护): ADC数据输入缓冲区。地址:0x80000000-0x80001FFF(8KB)。权限: 允许TPTC0写端口写入，禁止其读取（防止误操作）。其他主设备（如CPU）的权限由其他MPU（如CPU的MPU）管理。
    • Region 1 (读保护): 发送数据源缓冲区。地址:0x80002000-0x80002FFF(4KB)。权限: 允许TPTC0读端口读取，禁止其写入。
    • Region 2 (全保护): 关键代码或数据区。地址:0x00020000-0x00021FFF。权限: 禁止TPTC0的所有访问（读写均不允许），防止DMA破坏代码或关键数据。

  2. 步骤二：关闭MPU全局使能在修改配置前，先关闭MPU，避免在配置过程中因地址未定义而触发错误。

    REG_TPTCMPUENCFG &= ~((1<<0) | (1<<1)); // 关闭TPTC0 WR/RD MPU全局使能 __asm volatile("dsb sy");

  3. 步骤三：配置地址范围寄存器

    // Region 0: ADC输入缓冲区 (写端口) REG_TPTC0WRMPUSTADD0 = 0x80000000; REG_TPTC0WRMPUENDADD0 = 0x80001FFF; // 注意是结束地址，不是基址+大小 // Region 1: 发送源缓冲区 (读端口) REG_TPTC0RDMPUSTADD1 = 0x80002000; REG_TPTC0RDMPUENDADD1 = 0x80002FFF; // Region 2: 关键区保护 (读写端口都禁止) REG_TPTC0WRMPUSTADD2 = 0x00020000; REG_TPTC0WRMPUENDADD2 = 0x00021FFF; REG_TPTC0RDMPUSTADD2 = 0x00020000; // 起始地址相同 REG_TPTC0RDMPUENDADD2 = 0x00021FFF; // 结束地址相同 __asm volatile("dsb sy");

  4. 步骤四：配置区域使能位图

    uint32_t valid_cfg = 0; valid_cfg |= (1 << 0); // TPTC0WRMPURNGVLD bit0 -> Region 0 使能 valid_cfg |= (1 << 9); // TPTC0RDMPURNGVLD bit8 -> Region 1 使能 (注意是bit8) valid_cfg |= (1 << 2); // TPTC0WRMPURNGVLD bit2 -> Region 2 使能 valid_cfg |= (1 << 10); // TPTC0RDMPURNGVLD bit10 -> Region 2 使能 (bit8+2) REG_TPTCMPUVALIDCFG = valid_cfg; __asm volatile("dsb sy");

  5. 步骤五：开启MPU全局使能

    REG_TPTCMPUENCFG |= (1 << 0) | (1 << 1); // 使能TPTC0 WR和RD MPU __asm volatile("dsb sy"); __asm volatile("isb sy");

4.2 与系统内存布局及RTOS的协同

MPU配置不是孤立的，它必须与你的链接脚本（linker script）定义的内存布局完全匹配。你需要非常清楚每一段内存（.text, .data, .bss, 堆heap, 栈stack, 以及自定义的缓冲区）的起始和结束地址。在RTOS环境中，情况更复杂：

  • 任务栈保护：每个任务都有独立的栈空间。你可以为每个任务的栈配置一个MPU区域，并将结束地址设置为栈底（栈生长方向向下），起始地址设置为（栈底 - 栈大小 + 1）。这样，一旦任务栈溢出，MPU会立即检测到对保护区外的访问并触发错误，而不是破坏其他任务的数据。
  • 动态内存管理：如果使用堆（heap），保护起来比较困难，因为堆的地址是动态分配的。一种策略是将堆所在的整个大块内存作为一个区域，只防止TPTC访问（因为DMA通常不应访问动态堆），而CPU的访问由软件保证安全。
  • 共享内存区：多个任务或任务与DMA之间共享的缓冲区，必须配置为允许所有必要的主设备访问。权限设置要格外小心，通常设置为“可读可写”，但需配合信号量等机制进行软件同步。

实操心得二：调试阶段的“宽松”配置策略在项目初期，软件不稳定，频繁触发MPU错误会干扰调试。我的建议是采用分阶段策略：

  1. 阶段一（功能开发）：先不使能MPU，或只配置一个非常大的区域覆盖所有用到的内存，权限全开。重点是让功能跑通。
  2. 阶段二（集成测试）：逐步细化MPU区域。首先保护绝对不允许DMA访问的区域（如代码区、内核数据区）。然后保护各个静态缓冲区。
  3. 阶段三（可靠性验证）：启用最严格的配置，并设计测试用例故意制造越界访问，验证MPU错误处理机制（如错误地址捕获、中断响应）是否正常工作。

5. 高级话题：区域重叠、优先级与错误诊断

5.1 区域重叠与优先级规则

当访问的地址落在多个MPU区域的重叠范围内时，MPU如何裁决？TI的文档通常不会详细说明TPTC MPU的优先级规则，但根据通用MPU设计和输入资料中区域编号（Region 0-5）的设定，可以推断其采用了一种常见策略：区域编号可能具有优先级，通常编号小的区域优先级高。或者，硬件可能定义重叠区域的配置是“非法”的，行为未定义。

安全实践是：避免区域重叠。在规划内存布局时，就确保为不同用途的内存块分配不重叠的地址空间。如果因为内存碎片等原因无法避免，必须查阅芯片的详细技术参考手册，明确其重叠处理规则。在没有明确信息时，应按不重叠的方式进行配置。

5.2 利用MPUERRADD寄存器进行高效调试

TPTCxWRMPUERRADD和TPTCxRDMPUERRADD是调试MPU相关问题的利器。当系统因MPU错误进入异常或触发安全响应时，第一时间保存这个寄存器的值。

诊断流程：

  1. 捕获错误地址：在错误处理程序中，立即读取错误地址寄存器。
  2. 地址映射分析：将捕获的地址与你的内存映射表进行比对。这个地址属于哪个模块？是代码区、数据区、堆、栈还是外设寄存器？
  3. 回溯访问源：
    • 如果是写错误，分析TPTC的写传输配置（源地址、目的地址、传输长度）。计算目的地址+传输长度是否超出了你为它配置的允许写入的区域。
    • 如果是读错误，分析TPTC的读传输配置。检查源地址是否在你配置的允许读取的区域内。
  4. 常见原因：
    • 计算错误：传输的基地址或长度配置有误。
    • 对齐问题：MPU区域地址未按要求对齐，导致实际保护范围与预期不符。
    • 缓存一致性：如果使用了数据缓存（D-Cache），而DMA（TPTC）直接访问内存，必须确保在DMA操作前后正确执行缓存维护操作（Clean/Invalidate），否则CPU缓存中的数据与内存实际数据不一致，可能导致MPU检查的地址与实际传输的地址出现偏差。
    • 区域未使能：地址范围配置对了，但忘了在TPTCMPUVALIDCFG中置位对应的区域有效位。

5.3 性能考量与最佳实践

启用MPU会引入少量的地址比较和权限检查开销，但这对于现代处理器和总线架构来说通常是微不足道的，其带来的稳定性收益远远超过这点性能损耗。最佳实践包括：

  • 最少区域原则：只启用必要的保护区域。每个额外的区域都会增加一点比较逻辑。
  • 区域大小合理化：尽量让区域大小是2的幂次方，并且自然对齐，这样硬件实现更高效，有时甚至是强制要求。
  • 权限最小化：遵循最小权限原则。TPTC只需要读的缓冲区，就只配置读权限；只需要写的缓冲区，就只配置写权限。这能最大程度限制错误访问的影响范围。
  • 配置原子性：在更新MPU配置（尤其是同时更新多个相关寄存器）时，考虑使用临界区保护，或者确保在配置期间不会有受影响的DMA传输发生。先准备好所有新的配置值，然后短暂关闭MPU全局使能，快速更新地址和使能寄存器，最后重新打开全局使能。

6. 常见问题排查与实战陷阱实录

即使理解了所有原理，实际配置时还是会踩坑。下面是我在实际项目中遇到的一些典型问题及解决方案：

问题一：MPU配置后，TPTC传输立即失败，触发错误。

  • 排查：
    1. 检查TPTCMPUENCFG中的全局使能位TPTCxWRMPUEN/TPTCxRDMPUEN是否已置1。
    2. 检查TPTCMPUVALIDCFG中对应端口的区域使能位是否已置1。
    3. 使用调试器，在使能MPU前，读取并验证你配置的TPTCxWRMPUSTADDy和TPTCxWRMPUENDADDy寄存器的值，确认其与你计算的内存范围一致。
    4. 检查TPTC传输描述符中配置的地址和长度，确保其完全落在你定义的、已使能的MPU区域内。
  • 根本原因：99%的情况是地址范围不匹配或区域未使能。

问题二：系统运行一段时间后随机触发MPU错误。

  • 排查：
    1. 立刻保存TPTCxWRMPUERRADD寄存器的值。这是最关键的线索。
    2. 分析错误地址。如果地址看起来是合理的（例如在堆或栈空间内），考虑缓冲区溢出。可能是TPTC传输的数据块大小超过了接收缓冲区的容量，或者是软件计算的长度有误。
    3. 检查是否有多任务或中断上下文同时修改TPTC的传输描述符，导致配置被意外更改。需要加锁保护。
    4. 如果错误地址非常怪异（如0x00000000, 0xFFFFFFFF或非对齐地址），检查TPTC的初始化代码，确保其描述符链表或控制寄存器的初始状态是合法的，没有未初始化的指针。
  • 根本原因：动态行为导致的内存越界或并发访问冲突。

问题三：修改了MPU配置，但似乎没生效。

  • 排查：
    1. 确认你修改的是正确的TPTC实例（TPTC0 vs TPTC1）和正确的端口（WR vs RD）。
    2. 确保在修改配置前，已通过清除TPTCMPUENCFG中的TPTCxMPUEN位禁用了MPU。试图在MPU使能状态下修改地址范围或使能位图，行为可能是未定义的，或者硬件会忽略你的修改。
    3. 修改配置后，是否执行了足够的内存屏障（DSB和ISB）？在某些严格的架构下，配置更新需要同步到总线上才能生效。
    4. 读取回你刚刚写入的寄存器，确认写入的值是正确的。可能存在写缓冲或缓存一致性问题。

问题四：MPU错误触发了，但错误处理程序无法清除错误标志，系统卡死。

  • 排查：
    1. 确认你是在向TPTCxMPUERRCLR位写1，而不是写0。并且这个操作是“写1清零”，你只需要执行一次|=操作。
    2. 检查错误处理程序本身的执行路径。MPU错误可能是一种高优先级的安全错误，可能导致系统进入特定的错误处理模式（如Lockup）。你需要确认芯片的错误响应机制。有时，清除错误标志后，还需要执行其他系统级恢复操作。
    3. 更棘手的情况是，触发错误的访问源（TPTC）可能处于异常状态，持续发起非法访问，导致你刚清除标志，下一个周期又触发了。这时需要先停止出错的TPTC传输（暂停DMA通道），再清除错误标志。

避坑指南：配置检查清单在交付使用MPU保护的代码前，用这个清单核对一遍：

  • [ ] 所有MPU保护区域的地址和大小计算正确（结束地址 = 起始地址 + 大小 - 1）。
  • [ ] 地址满足硬件对齐要求（参考芯片勘误表或TRM）。
  • [ ]TPTCMPUVALIDCFG寄存器中，需要使能的区域对应位已置1。
  • [ ]TPTCMPUENCFG寄存器中，对应端口的全局使能位TPTCxMPUEN已置1。
  • [ ] TPTC传输描述符中的地址/长度与MPU区域定义一致。
  • [ ] 对于可缓存内存，在TPTC操作前后正确执行了缓存维护操作。
  • [ ] MPU错误处理函数已实现，并能正确读取TPTCxMPUERRADD和清除错误标志。
  • [ ] 在RTOS环境下，任务栈的MPU保护已考虑栈生长方向。
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